L9396 datasheet(7/109 Pages) STMICROELECTRONICS

7 / 109 page

DS12539 Rev 10

7/109

L9396

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109

List of figures

Figure 1.

Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

Figure 2.

Pins connection diagram (top view) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10

Figure 3.

Boost regulator block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Figure 4.

Charge pump block diagram. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

Figure 5.

VCORE configuration diagram (buck regulator - top, linear regulator - bottom) . . . . . . . . . 27

Figure 6.

Power up sequence from wake up input. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

Figure 7.

Power down sequence from wake up input . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Figure 8.

Standstill operation diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

Figure 9.

Wheel speed sensor protocol types . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

Figure 10.

ADC conversion time . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

Figure 11.

Reset input logic diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 68

Figure 12.

Reset output logic diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

Figure 13.

WD1 block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

Figure 14.

Mono-directional timing check evolution. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

Figure 15.

Bidirectional timing check evolution . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

Figure 16.

Timing State evolution depending on WD_TO_RST_EN and WD_REQ_CHECK_EN . . . 74

Figure 17.

WD1 state machine . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

Figure 18.

WD1_RESET & DRIVERS ENABLE versus WD_CNT value. . . . . . . . . . . . . . . . . . . . . . . 76

Figure 19.

Seed generation algorithm block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

Figure 20.

Seed selection and elaboration flow . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

Figure 21.

Answer check generation algorithm block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

Figure 22.

WD2 timing diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83

Figure 23.

WD2 diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

Figure 24.

GSW[8..0] bits. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

Figure 25.

SPI timing diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

Figure 26.

TQFP64 (10x10x1 mm exp. pad down) package outline . . . . . . . . . . . . . . . . . . . . . . . . . 104

Figure 27.

TQFP64 (10x10x1 mm exp. pad down) marking information . . . . . . . . . . . . . . . . . . . . . . 107

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